图书简介

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商品基本信息，请以下列介绍为准
商品名称：	DSPIC数字信号控制器入门与实战--入门篇
作者：	石朝林 编著
市场价：	49元
文轩网价：	39.2元【80折】
ISBN号：	9787811242133
出版社：	北京航空航天大学出版社
商品类型：	图书

其他参考信息（以实物为准）
随书附赠：附1光盘
装帧：平装	开本：16开	语种：中文
出版时间：2009-08-01	版次：1	页数：464
印刷时间：2009-08-01	印次：1	字数：689.00千字
温馨提示：出版时间超过3年的图书，因长时间储存可能会产生纸张缺陷，敬请谅解！

内容简介

本书可以称作16位DsC的“入门篇”。侧重于dsPIc30F／33F系列16位数字信号控制器的基础知识和相关实际工程经验的介绍。针对这一系列McU的架构、外设、存储器模式、寻址模式、开发工具等进行循序渐进、深入浅出的介绍，从入门到精通再到实战。提供了关于数字滤波、FFT等实战范例，帮助工程师系统学习和研究，同时把指令集以简洁的表格形式呈现在读者面前，方便编程时迅速准确查找。 本书可作为工程技术人员迅速掌握dsPIC30F／33F系列16位数字信号控制器开发技术的实用参考书。

作者简介

石朝林，毕业于哈尔滨理工大学电机系电气自动化专业.后进修于清华大学电子系电子技术与计算机技术专业。毕业后在北京机械工业学院先后担任精密仪器系和自动化系实验员、实验室主任职务。后就职于香港科汇北京办事处负责8位、32位处理器技术支持。目前就职于微芯科技北京办事处.担任主任工程师，主要负责Mcu类产品技术支持。 作者有累计17年嵌入式系统工程设计经验，组织和参加过多个涉及MCu和模拟电路的技术开发项目，具有比较丰富的开发经验。

目录

第1章 CPU架构 1.1 概述 1.2 编程者模型(Programmer’sModel) 1.2.1 工作寄存器堆 1.2.2 影子寄存器(ShadowRegister) 1.2.3 未初始化的w寄存器的复位 1.3 软件堆栈(SoftwareStack) 1.3.1 软件堆栈示例 1.3.2 W14软件堆栈帧指针 1.3.3 堆栈指针上溢(Overflow)和下溢(Underflow) 1.4 与核心相关的寄存器 1.4.1 状态寄存器(SR) 1.4.2 核心控制寄存器(CORCON) 1.4.3 其他CPU控制寄存器 1.5 算术逻辑部件(ALU) 1.6 DSP引擎 1.6.1 累加器(Accumulators) 1.6.2 乘法器(MultipIier) 1.6.3 累加器与加法器 1.6.4 舍人逻辑(RoundLogic) 1.6.5 桶形移位寄存器(BarrelShifter) 1.6.6 DSP引擎陷阱事件 1.7 除法器 1.8 指令流类型 1.9 循环结构 1.9.1 REPEAT循环结构 1.9.2 DO循环结构 第2章 中断系统 2.1 中断系统简介 2.2 中断优先级(Interrupt Priority) 2.2.1 用户中断优先级 2.2.2 CPU中断优先级 2.3 中断的操作过程 2.4 中断嵌套(Interrupt Nest) 2.5 非屏蔽中断陷阱(Non-Maskable Trap) 2.5.1 软陷阱(Solt Trap) 2.5.2 硬陷阱(Hard Trap) 2.6 软件禁止中断指令(DISI) 2.7 利用中断将CPU从SLEEP和IDLE状态唤醒 2.8 外部中断源 2.9 中断处理时序 2.9.1 单周期指令的中断响应时间 2.9.2 双周期指令的中断响应时间 2.9.3 从中断返回 2.9.4 中断响应时间的特殊情况 2.10 中断设置流程 2.10.1 初始化 2.10.2 中断服务程序 2.10.3 禁止中断 2.11 和中断相关的寄存器 第3章 程序存储器与数据存储器 3.1 程序存储器与EEPROM 3.1.1 程序存储器地址映射 3.1.2 程序计数器PC 3.1.3 从Flash或EEPROM进行数据读写的方法 3.2 数据存储器 3.2.1 概述 3.2.2 数据区地址发生单元(AGU) 3.2.3 模数寻址(ModuloAddressing) 3.2.4 位反转寻址(BitReversedAddressing) 第4章 定时计数器 第5章 A／D转换器及其应用 第6章 DMA控制器(DMAC) 第7章 串行通信端口 第8章 输入捕捉与输出比较 第9章 电机控制*外设 第10章 时钟电路 第11章 系统管理模块 第12章 I/O商品及相关功能 第13章 开发工具 第14章 数字滤波器设计 第15章 实时时钟模块（RTC） 附录A 快速傅里叶变换（FFT） 附录B 指令集详解 附录C 利用DSP核提高直流无刷电机的PID效率 附录D 随身携带的PIC开发利器PICKit2 参考文献

精彩内容

第1章 CPU架构 1.1 概述 dsPIC30F系列的CPU采用了改良型哈佛架构，其数据总线和程序总线是独立的，这样有效地消除了数据传输的瓶颈。说它是改良型哈佛结构，主要在于：数据总线宽度为16位，程序总线宽度为24位；程序区和数据区也可以交换数据（PSV、表读/表写）等。同时该芯片包含了强大的DSP引擎支持，拥有一个增强功能的指令集，为数字信号处理提供了硬件支持。由于CPU拥有24位宽度的程序指令字，指令字带有长度可变的操作码字段。程序计数器（PC）的长度为23位，其最低位强制为0，因此可以寻址高达4M×24位的用户程序存储器空间。单周期指令和预取机制可以提供最大的吞吐量。除了改变程序流的指令（比如GOTO、CALL）、双字移动指令（MOV.D）和表操作指令以外，所有指令都在单个周期内执行。硬件支持DO和REPEAT指令，意味着可以免除大多数影响程序执行的“家务活”，比如维护循环次数（加或减）、判断循环是否到达预定值、跳转等工作。更为重要的是，DO和REPEAT在执行的时候可以被中断。 ……

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